srl

srl

Assembly RISC-V Referência

lyszt.net aborda srl e outras instruções RISC-V com mais detalhes.

Formato de codificação

R
31–25funct7
24–20rs2
19–15rs1
14–12funct3
11–7rd
6–0opcode
I
31–20imm[11:0]
19–15rs1
14–12funct3
11–7rd
6–0opcode
S
31–25imm[11:5]
24–20rs2
19–15rs1
14–12funct3
11–7imm[4:0]
6–0opcode
B
31–25imm[12,10:5]
24–20rs2
19–15rs1
14–12funct3
11–7imm[4:1,11]
6–0opcode
U
31–12imm[31:12]
11–7rd
6–0opcode
J
31–12imm[20,10:1,11,19:12]
11–7rd
6–0opcode

Descrição

srl desloca os bits para a direita, o inverso do que sll faz. As letras significam shift right logical (deslocamento lógico à direita). Esta forma pega os bits de rs1, desloca-os para a direita pela contagem em rs2 e armazena o resultado em rd.

srl rd, rs1, rs2

Quaisquer bits empurrados além da extremidade direita são perdidos, e 0s preenchem os espaços vagos à esquerda.

Esse preenchimento com zeros explica a palavra logical. Um deslocamento à direita divide um valor pela metade, então um deslocamento de 1 divide por 2 e um deslocamento de 3 divide por 8. O resto é descartado, correspondendo à divisão inteira. srl divide um número sem sinal por uma potência de dois rapidamente.

Existem duas instruções de deslocamento à direita, e a diferença está no que vai para os bits altos esvaziados. srl coloca 0s lá. Sua contraparte sra copia o bit de sinal para essas posições, o que preserva o sinal de números negativos. Escolha srl para um padrão de bits bruto ou um valor que não pode ser negativo. Em um valor com sinal que pode ser negativo, srl produz um grande número positivo, e sra é a instrução correta nesse caso.

De acordo com o manual RISC-V, a contagem de deslocamento ocupa os 5 bits baixos do registrador rs2. Esses 5 bits abrangem de 0 a 31 posições, então os bits restantes de rs2 são ignorados. O manual chama srl de deslocamento lógico à direita, que insere zeros no topo.

Quando a contagem de deslocamento é uma constante, use a forma imediata srli.

Exemplo

li t0, -8
li t1, 1
srl t2, t0, t1   # t2 = 2147483644 (zero-filled)

Referências

  1. [1]RISC-V International. The RISC-V Instruction Set Manual, Volume I: Unprivileged Architecture. Version 20260120. Section 2.4.2, Integer Register-Register Instructions, page 29.
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